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您的位置网站首页>>数字电路>>4.1触发器-时钟触发器的逻辑功能
责任编辑:刘昆山

二、时钟触发器的逻辑功能

  具有时钟脉冲CP输入控制端的触发器称为时钟触发器。它的状态变化不仅取决于输入信号的变化,还取决于时钟脉冲CP的作用。这样,数字系统中的多个钟控触发器可以在统一的信号控制下协调地工作。按功能划分有RS触发器、D触发器、JK触发器、T触发器。
1.RS触发器  

           
  电路组成如图4-2所示。两个输出端Q、,两个输入端R、S,一个时钟控制端CP。
  工作原理:
  CP=0:无论R、S取何值,维持原状态。
  CP=1:R=1,S=0时,=0;
     R=0,S=1时,=1;
     R=S=0时,
     R=S=1时,不确定。
 功能真值表:如表4-1所示。
 激励表:如表4-2所示。

   

  根据上述分析,可以列出其特性方程

  

         


 状态图:如图4-3所示。
  
RS触发器的缺点是输入存在约束条件。        

2.D触发器

  电路组成如图4-4所示。只有一个输入端D,一个时钟控制端CP。
  工作原理:  
  当CP=0时,无论D为何值,维持原状态。
  当CP=1时,若D=0,则=0;若D=1,则=1。
  功能真值表如表4-3所示。
  激励表如表4-4所示。
  特性方程: 
         =D(CP=1)
  状态图如图4-5所示。
   D触发器的优点是输入端不存在约束。

   


3.JK触发器

电路组成如图4-6所示。输入门在RS触发器的基础上添加两根反馈线,克服了约束。
 工作原理:
 当CP=0时,不论JK为何值,维持原状态。  
 当CP=1时,J=1,K=0,不论初态如何,=1;
       J=0,K=1,不论初态如何,=0;
       J=K=1时,=0,则=1;=1,则=0。
 功能真值表如表4-5。  
 激励表如表4-6。
 状态图如图4-7。 

  

4.T触发器

电路组成如图4-8所示。将JK触发器的J、K端连在一起,作为一个输入端T,即是T触发器。
 工作原理: 
 
当CP=0时,不论JK为何值,维持原状态不变。
 当CP=1时,T=0,维持原状态不变;T=1,=0,=1;=1,=0。
 功能真值表:如表4-7。 
 激励表:如表4-8。
 状态图:如图4-9。

    

  这里介绍的四种触发器都是电位触发方式,即只有在CP=1时,触发器才能接收信号。下面介绍这些触发器其它触发方式的结构形式,即维持阻塞触发器、边沿触发器和主从触发器三种触发器。

上一页: 4.1触发器-触发器概述
下 一页:
4.1触发器-钟控触发器的触发方式
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